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B43703B4338M000_Datasheet PDF

来源:LM317 Electronics Components编辑:American Microsemiconductor, Inc.时间:2021-06-15 13:50:32

The software, which can interface with numerous network design and planning tools, including Ericsson's TEMS, Atoll from Forsk and a tool from Agilent, is designed for use either ahead of deploying a network in an effort to reduce capital expenditure or when expanding coverage of an existing network. The kit provides a bridge between radio network design and field optimisation.

The Accelera 3000 platform comes as a full length PCI-X card featuring four of Aspex' Linedancer processors Each Linedancer contains 4096 processing elements.

Core processing algorithms typically run 20 to 40 forty times faster than a high-end dual processor PC platform, the company claimed. The bandwidth of the PCI-X interface allows the transfer of 16-bit high-definition 1080-line interlaced or 720 line progressive scan RGB images to and from the Accelera platform in real-time, Aspex said.

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Thanks to the software programmability of Linedancer, customers starting their development today with the Accelera platform will be able to launch new products by next year's NAB show,” said Jeremy Hendy, vice president of marketing at Aspex Semiconductor, in a statement.

LONDON — ADC has joined the growing list of network infrastructure companies opting to combine wireline and wireless business in a major reorganization announced Wednesday (Sept. 15).

The shake-up means the company's regional leaders for the Americas, Europe/Middle East/Africa, Asia and the Asia-Pacific regions will now report directly to Robert Switz, president and CEO.

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Mike Pratt was named president of the newly combined business unit.

This change provides a clear and direct linkage between the CEO and the decision-makers in the regions and business units, facilitating rapid execution in the marketplace,” Switz said in a statement.

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Pratt has served as vice president of ADC's wireline operation since May 2002. He previously worked at Marconi, where he was executive vice president of the broadband access division.

Prior to this reorganization, ADC's regional vice presidents reported to Ron Lowy, who previously served as president and COO of the KRONE Group. The group was acquired by ADC in May. Lowy will be leaving ADC following a brief transition period.

Der ASIC-Entwickler und IP-Anbieter aus Hsinchu preist den NC-I als High-Performance-NPU mit Prüfsystemen auf Paketebene und einer Mechnismen zur Verarbeitung der Layer 4 bis 7. Spannend an dem Chip ist, dass er mit seinem Stückpreis von 20 US-Dollar so günstig wie ein ASSP ist, gleichzeitig aber die Flexibilität und schnellere Zykluszeit eines strukturierten ASIC bietet.

Der NS-I ist als Single-Chip-Implementierung für vDSL-Gateways oder als Beschleuniger für Netz-Applikationen auf PowerPC- oder Pentium-Basis ausgelegt.

Der Netzprozessor kommt mit Faradays hauseigener 500-MHz-ARMv4-CPU namens FA626 und bietet einen Befehls- und Daten-Cache von je 32 KByte, einen einheitlichen Level-2-Cache und eine getrennte 32-Bit-Schnittstelle für den Zugriff auf Chip-externes SRAM.

Die Art und Weise wie Faraday diese Standard-Komponenten miteinander vereint, scheint ein weiteres Steckenpferd des Unternehmens zu sein. Statt auf einen Standard-Amba-Bus zurückzugreifen, hat Faraday einen eigenen blockierungsfreien 64-Bit-Crossbar-Switch entwickelt, der mit 166 MHz läuft. Faraday will mit damit Systementwicklern mehr Spielraum bei der Optimierung des Verkehrsaufkommens abhängig von der Bandbreite und Latenzzeit geben. Außerdem hält das Unternehmen seine Systemarchitektur für besser geeignet für QoS-abhängige Applikationen – etwa hochauflösende Video-Übertragungen.

Mit dem strukturierten ASIC-Ansatz erhalten Entwickler jetzt für die Implementierung von geistigem Eigentum (IP) einen SRAM mit 0,5 MBit und einen programmierbaren Zellen-Array von 1,5 Millionen Metall-Gattern.

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